Logic Circuit Simulation in C++ 0.0.59
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http://sourceforge.net/projects/liblcs/files/liblcs/libLCS-0.0.59/libLCS-0.0.59.zip/download
关于 Logic Circuit Simulation in C++
liblcs 是一个硬件描述库C++旨在像 Verilog HDL 一样强大和简单。它目前支持逻辑门,翻转,时钟,并方便延迟,连续赋值和可变值转储到VCD文件。
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